英语翻译
来源：学生作业帮助网 编辑：六六作业网 时间：2024/12/26 02:54:12
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译码器模块主要是产生16路的分区信号（低电平有效）分别控制16个锁存器,把16个分区的显示数据分别锁存在相应的锁存器中.
The decoder module partition signal generating 16 Road(active low) to respectively control the 16 latch,the 16partition of the display data are latched corresponding latch.
3.5数据锁存器组及移位寄存器组模块
3.5 data latches and shift register module
数据锁存器组模块由16个8位锁存器组成锁存器组、锁存16个分区的数据.移位寄存器组模块16个8位寄存器组成,把各路锁存器中8位并行数据转换成同时输出的16路串行数据,驱动LED显示屏,实现数据并转换.
The data latch module consists of 16 8 bit latch latcheslatch group,16 partitioned data.Shift register groupmodule 16 8 bit registers,the various latch 8 bit parallel data into 16 serial data output at the same time,LED display driver,and realize data conversion.
其生成的元件符号如图6所示.其中,DATA—IN[70] 为每个分区的8位并行数据上输入,SCLK为移位时钟,LOAD为数据锁存信号,CS[150]为16分区的输入信号（接译码器的输出）DATA_OUT[150]为16路的串行数据输出.
The element symbol as shown in figure 6.Among them,DATA IN[70] is a 8 bit parallel data for each partition of theinput,SCLK clock,LOAD as the data latch signal,CS[150] as the input signal of 16 partitions (output of the decoder)DATA_OUT[150] serial data output 16 road.